de28d1.v
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module de28d1 (z0n, z1n, z2n, z3n, z0, z1, z2, z3, a0, a1, en);
input a0, a1, en;
output z0n, z1n, z2n, z3n, z0, z1, z2, z3;
`ifdef SYNTH
reg z0nt, z1nt, z2nt, z3nt;
not p1(z3, z3nt),
p2(z2, z2nt),
p3(z1, z1nt),
p4(z0, z0nt);
buf b1(z3n, z3nt),
b2(z2n, z2nt),
b3(z1n, z1nt),
b4(z0n, z0nt);
always @(a0 or a1 or en)
begin
if (en==1)
{z0nt, z1nt, z2nt, z3nt} = 4'b1111;
else
begin
case({a0, a1})
2'b00: {z0nt, z1nt, z2nt, z3nt} = 4'b0111;
2'b10: {z0nt, z1nt, z2nt, z3nt} = 4'b1011;
2'b01: {z0nt, z1nt, z2nt, z3nt} = 4'b1101;
2'b11: {z0nt, z1nt, z2nt, z3nt} = 4'b1110;
endcase
end
end
`else
or G2(J$z2n, N3, en),
G3(N3, N4, a0);
not G4(N4, a1),
G5(z2, J$z2n);
buf E0(z2n, J$z2n);
or G7(J$z3n, N8, en),
G8(N8, N9, N10);
not G9(N9, a1),
G10(N10, a0),
G11(z3, J$z3n);
buf E1(z3n, J$z3n);
or G13(J$z0n, N14, en),
G14(N14, a1, a0);
not G15(z0, J$z0n);
buf E2(z0n, J$z0n);
or G17(J$z1n, N18, en),
G18(N18, a1, N20);
not G20(N20, a0),
G23(z1, J$z1n);
buf E3(z1n, J$z1n);
`endif
endmodule