rcp_floorplan.flr 15.4 KB
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#cell2 * rcp_floorplan flr * 28 any 0 v8r4.6.4
# "26-Jan-95 GMT" "21:10:18 GMT" "26-Jan-95 GMT" "21:10:18 GMT" rohm * .
# floor plan information
V 3 ChipComp/ChipAssist
A 1224 -25680 58256 28930
B 1223 -25681 58257 28931

$FLOORPS
NOOFSTDCELLAREA 1
BASENAME 
SEEDTOLERANCE 0
FLOORPLANTYPE 3
NOOFROWS 5
MAXWIDTH 1000
ASPECTRATIO 1
ROUTINGFACTOR 1.2
OPTIONS 10361
ROWTOLERANCE 1
CONNECTORSIDE 17
PACKAGENAME x125
DEVICENO 
PADRINGTYPE 
CORNERPAD 17
POWERBUSSIZE 1
OPERFREQ 10M
POWERBUSWIDTH 30
PREFERPOWER 1
PADPITCH 620
$END
H rdp_0/tc_logic tc_logic 0 31444 13764 0 0
H if_logic if_logic 0 23532 -16953 0 0
H rdp_0/memspan memspan 0 31621 -16716 0 0
H rsp_0/data_unit data_unit 0 3989 11525 0 0
H rdp_0/tm_tf tm_tf 0 46015 3887 0 0
H rdp_0/cs_ew_cv cs_ew_cv 0 31676 1258 0 0
H vclk_driver_0 vclk_driver 0 45825 -17961 0 0
H pad_0/syn_clk_bufbot0 syn_clk_buf 0 3820 -18560 0 0
H pad_0/syn_clk_bufbot1 syn_clk_buf 0 31441 -18535 0 0
H pad_0/syn_clk_buftop1 syn_clk_buf 6 31441 21810 0 0
H pad_0/syn_clk_buftop0 syn_clk_buf 0 3853 21560 0 0
H pi_0 pi 0 15498 -17339 0 0
H rsp_0/vu/vusl67 vusl 0 16363 -8166 0 0
H rsp_0/vu/vusl45 vusl 0 16359 -795 0 0
H rsp_0/vu/vusl23 vusl 0 16345 6556 0 0
H rsp_0/vu/vusl01 vusl 0 16347 13891 0 0
H rdp_0/bl_logic bl_logic 0 31399 -1015 0 0
H io_ri io_ri 0 3764 -1904 0 0
H rsp_0/vu/div1 div 4 23068 -11632 0 0
H rdp_0/cc_logic cc_logic 0 46215 -4452 0 0
H vi_0 vi 0 47151 -18901 0 0
H tst_0 tst 0 20504 -16297 0 0
H rsp_0/iu iu 0 4148 -17562 0 0
I "rcp_sc"  "rcp_sc"  "" V 4180 -2079 4260 -1999 1 1.2 1 11021 1 1 0 0

$SEEDS
$END

$GUIDANCE
$NET "vdd" P
$VERTICES
1 45296 26645
2 45296 11126
3 51012 26645
4 45296 -17795
5 45296 -20839
6 50573 -20839
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8 29283 -20839
9 29283 26645
10 29283 16771
11 13242 26645
12 13242 14717
13 13242 -10103
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18 4210 -2025
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23 45296 -1036
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27 48894 11126
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$EDGES
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99 200 0 102 107
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$NET "gclk" 
$VERTICES
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2 43273 -24702
3 39243 27844
4 39243 25203
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12 49082 10833
13 44584 10833
14 44584 17726
15 39103 7218
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17 44584 25203
18 44584 -21783
$EDGES
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$NET "vclk" 
$VERTICES
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2 44655 -17757
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4 49775 -14277
5 44655 -18306
6 29075 -18306
7 29075 -13774
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$EDGES
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$NET "clock" 
$VERTICES
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2 22655 -24574
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$EDGES
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$NET "syn_clk" 
$VERTICES
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2 3311 -18512
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$EDGES
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$NET "pad_0/syn_clkbot" 
$VERTICES
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4 3977 -18520
$EDGES
1 0 0 1 2
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$NET "pad_0/syn_clktop" 
$VERTICES
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3 3973 26425
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$EDGES
1 0 0 1 2
2 0 0 1 3
3 0 0 3 4
$END
$END